Perguntas com a marcação «vhdl»

A linguagem de descrição de hardware VHDL (VHSIC (circuito integrado de velocidade muito alta)) é uma linguagem de descrição de hardware usada na automação de design eletrônico para descrever e projetar sistemas digitais, como matrizes de portas programáveis em campo e circuitos integrados.

Projeto para aprender VHDL

Sou estudante de EE e posso escrever [pelo menos simples] programas em mais idiomas do que os meus dedos. Acabei de começar a aprender VHDL e estava pensando em qual seria um bom projeto para realmente conhecer o idioma e as ferramentas relevantes? Estou tendo problemas para criar um, porque …

16 fpga xilinx vhdl

Qual é a diferença entre teste e verificação?

Todo livro didático que eu vi mostra muito o fato de que teste e verificação são dois conceitos diferentes. No entanto, nenhum deles fornece uma distinção clara (ou suficientemente clara para mim, finalmente). Para fornecer algum contexto, estou interessado na verificação de projetos de hardware digital usando HDLs (linguagens de …

15 vhdl verilog test system-verilog verification

VHDL: Nomenclatura e interpretação da arquitetura

Nota: Estou usando o ISE da Xilinx e tenho uma placa FPGA para trabalhar (com interruptores, luzes e assim por diante), e hackeei alguns projetos simples até agora. Ao mesmo tempo, estou lendo vários tutoriais para criar uma base para o que estou fazendo. Eu já vi várias entidades e …

14 vhdl architecture best-practice

Como os transistores BJT funcionam em um estado saturado?

Isto é o que eu sei sobre NPN BJTs (transistores de junção bipolar): A corrente do emissor base é amplificada vezes HFE no emissor-coletor, de modo que Ice = Ibe * HFE Vbeé a tensão entre o emissor-base e, como qualquer diodo, é geralmente em torno de 0,65V. Não me …

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O que me faria escolher o Verilog ou o VHDL em vez do design esquemático em CPLDs ou FPGAs?

Não tenho absolutamente nenhum conhecimento de lógica programável, uso principalmente microcontroladores em meus projetos, mas recentemente precisei trabalhar com vídeo e o microcontrolador é muito lento para o que precisava, então comecei a jogar com CPLDs. Consegui obter bons resultados com o CPLD apenas usando o desenho esquemático, mas ao …

13 vhdl verilog programmable-logic

Como dividir 50MHz para 2Hz em VHDL no Xilinx FPGA

Eu tenho uma placa FPGA Xilinx, com um cristal de 50 MHz. Eu preciso dividir isso em 2Hz em VHDL. Como eu faço isso?

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Design de firmware FPGA: Quão grande é muito grande?

Eu tenho uma transformação de processamento de sinal particularmente grande que precisa ser portada do matlab para o VHDL. Definitivamente requer algum tipo de compartilhamento de recursos. Um pouco de cálculo me deu o seguinte: 512 pés de 64 pontos 41210 operações de adição múltipla Considerando que o maior FPGA …

12 fpga vhdl xilinx

Placa de desenvolvimento FPGA barata [fechada]

Fechadas. Esta questão está fora de tópico . No momento, não está aceitando respostas. Deseja melhorar esta pergunta? Atualize a pergunta para que ela esteja no tópico do Electrical Engineering Stack Exchange. Fechado há 4 anos . Quero começar com o FPGA, mas nunca trabalhei antes. Quero um kit barato, …

12 fpga vhdl jtag

recomendações de livros sobre FPGA [fechado]

Fechadas. Esta questão está fora de tópico . No momento, não está aceitando respostas. Deseja melhorar esta pergunta? Atualize a pergunta para que ela esteja no tópico do Electrical Engineering Stack Exchange. Fechado há 2 anos . que títulos de livros você recomendaria para começar com FPGAs e VHDL? edit …

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Como depurar sinais vermelhos no ModelSIM?

Eu tenho que projetar uma máquina de estado usando apenas portas NAND para a parte combinatória e chinelos D para a lógica seqüencial. Tudo deve funcionar com um relógio de 1ghz / 53. Agora, antes de me agredir com "não faremos o dever de casa por você", deixe-me dizer que …

11 digital-logic vhdl modelsim

Como posso especificar sinais "não me importo" em VHDL?

Nos cursos de Design Lógico, todos aprendemos que é possível minimizar uma função lógica, por exemplo, usando um mapa de Karnaugh ou o algoritmo Quine – McCluskey . Também aprendemos que os valores "Não me importo" aumentam o potencial de minimização. Por exemplo, pegue um arquivo de registro. Os sinais …

11 vhdl synthesis optimization

Como identificar áreas de um projeto de FPGA que usam mais recursos e área?

Estou trabalhando em um projeto de FPGA grande e estou muito próximo dos limites de recursos do FPGA que estou usando atualmente, o Xilinx LX16 no pacote CSG225. O design também está quase completo, no entanto, no momento, ele não se encaixa mais no FPGA. Posso desligar as peças para …

11 fpga vhdl xilinx spartan optimization

Diferença entre declaração If-else e Case em VHDL

Eu quero entender como diferentes construções no código VHDL são sintetizadas em RTL. Alguém pode me dizer a diferença entre a construção If-Else e a instrução Case de um processo em VHDL em termos de como o código é inferido no circuito RTL pela ferramenta de síntese? Considere o caso …

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Quando é melhor usar representações de VETOR vs INTEIRO?

No tópico de comentário de uma resposta a esta pergunta: Saídas incorretas na entidade VHDL , foi afirmado: "Com números inteiros, você não tem controle ou acesso à representação lógica interna no FPGA, enquanto o SLV permite fazer truques como utilizar a cadeia de transporte com eficiência" Então, em que …

11 fpga vhdl

Você usa VHDL hoje em dia?

Sou estudante de engenharia elétrica e estou estudando a linguagem de descrição de hardware conhecida como VHDL. Eu procurei no Google procurando por um IDE (estou usando um Mac), mas essa linguagem parece bastante morta. Então, eis a minha pergunta: no meu futuro emprego como engenheiro elétrico, o VHDL será …

11 vhdl

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